ingénieur électronique numérique VHDL

  • Par Atos
  • Stage
  • Aix-en-Provence (Bouches-du-Rhone)
  • Master, Bac +5
2016-11-30T01:10:37+0100

Description de l'offre

La mission consiste à mettre en place des outils de vérification suivant la méthodologie UVM (Universal Verification Methodology) et d'un environnement de tests de non régression en simulation automatisés.

Le domaine visé est le traitement du signal appliqué aux signaux de radiocommunication.


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Pour postuler :
http://atos.contactrh.com/jobs/4529/16549101

Profil recherché

Projet de fin d'étude de 6 mois pour un cursus ingénieur microélectronique numérique.

Il est demandé :
Des connaissances théoriques sur les signaux de radiocommunication.
De bonnes bases de language VHDL et/ou Vérilog avec, si possible, la mise en pratique sur FPGA.
Une connaissance des outils suivants : Matlab, Modelsim, Quartus, ISE ou Vivado

Polyvalent(e) et autonome, vous avez une capacité d'adaptation et d'apprentissage rapide.

Vous souhaitez valoriser votre fibre technique et explorer de nouvelles frontières par le biais d'une expérience formatrice dans un secteur en pleine mutation. Vous avez le goût du challenge, le sens du travail en équipe, et souhaitez évoluer dans un environnement stimulant.

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À propos de Atos

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