Expire bientôt Thales

Stage Bac +4 - Analyseur du déroulement de scripts de conception d’ASIC (H/F)

  • Stage
  • Gennevilliers (Hauts-de-Seine)
  • Design / UX / UI

Description de l'offre

QUI SOMMES-NOUS ?

Rejoignez Thales, leader mondial des technologies de sûreté et de sécurité pour les marchés de l'Aérospatial, du Transport, de la Défense et de la Sécurité . Fort de 62 000 collaborateurs dans 56 pays , le Groupe bénéficie d'une implantation internationale qui lui permet d'agir au plus près de ses clients, partout dans le monde .

Les 14 000 collaborateurs de l' activité Systèmes d'information et de communication sécurisés développent des systèmes de communications militaires et de numérisation de l'espace de bataille , des systèmes de sécurité urbaine , de protection des États et des infrastructures critiques , ainsi que des solutions de cybersécurité .

Le site de Gennevilliers est le cœur des activités de conception, de développement et de soutien des produits et solutions de radiocommunications des armées, des réseaux d'infrastructures résilients et de communications par satellite , ainsi que des solutions de cybersécurité .

La Direction des Opérations recherche un/une Stagiaire analyseur du déroulement de scripts de conception d'ASIC (H/F).

Basé(e) à Gennevilliers.

QUI ETES-VOUS ?

Vous possédez des connaissances en outils de scripting, Excel et macros ainsi qu'en langage HTML ou autre langage d'interface web.

CE QUE NOUS POUVONS ACCOMPLIR ENSEMBLE :

Au sein du service ‘System On Chip', en charge de la conception de circuits (FPGA et ASIC) de sécurité et de radio numérique.

A ce titre, vous aurez l'opportunité d'améliorer le cycle de conception d'ASICs complexes en mettant en place des outils d'analyse du déroulement de scripts de conception. La conception d'ASIC utilise des outils CAO qui génèrent des fichiers de rapport (au format texte) regroupant énormément d'informations pour indiquer aussi bien le bon déroulement des étapes de conception, des Warnings d'importance variable et des erreurs pouvant être fatales pour le bon fonctionnement de l'ASIC ou System on Chip (SoC). La structure de ces rapports rend difficile l'extraction rapide de l'information recherchée. En effet, selon l'avancement du Design le concepteur doit être vigilent à certains warning alors que d'autres peuvent être adressés par la suite.

Le but du stage est de réaliser un outil paramétrable afin de classer et présenter clairement le contenu des fichiers de rapport selon les types d'alertes, leur occurrence, leur localisation dans le circuit, leur impact, leur sévérité….

Le candidat sera force de proposition pour présenter les résultats dans une interface WEB, dans un fichier EXCEL ou tout autre support.

La perspective de rejoindre un Groupe innovant vous motive ? Alors rejoignez-nous en postulant à cette offre .
Vous souhaitez en savoir plus sur les activités Systèmes d'information et de communication sécurisés ? Cliquez ici et ici .

Faire de chaque avenir une réussite.
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