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Expire bientôt STMicroelectronics

STAGE PFE: Ingénieur.e Verification digitale M/F

  • Stage
  • Grenoble (Isère)
  • Développement informatique

Description de l'offre

General information

Reference

2021-17158  

Job level

20 - Professional First Level

Position description

Posting title

STAGE PFE: Ingénieur.e Verification digitale M/F

Regular/Temporary

Temporary

Contract duration (nb of months)

6

Job description

Vous serez intégré(e) à l’équipe Computing & Compiler Center au sein de l’entité Strategy Technology & Systems Architecture du groupe MDG. Cette équipe est responsable de la conception et du développement de micro-processeurs propriétaires, ainsi que des outils de développement associés comme des compilateurs incluant des fonctionnalités de cyber-sécurité. Elle fournit également les services d'intégration continue à de nombreuses organisations dans ST.

Vous intégrerez l’équipe en charge de la vérification fonctionnelle des processeurs embarqués.
Cette équipe est responsable, notamment, de la définition de la stratégie de vérification des processeurs embarqués, de sa mise en œuvre, et de la garantie de la conformité de l’implémentation par rapport aux spécifications.

Votre mission principale consistera à participer à la vérification de processeurs conçus par l’équipe, en utilisant des outils de vérification dynamique ou formelle. Vous serez amené à participer à l’écriture du plan de vérification en fonction de l’architecture et de la micro-architecture des processeurs, à définir les critères de couverture et de qualification, à gérer l’exécution des tests et analyser les résultats de simulation et de couverture, et à collaborer avec les différentes équipes pour analyser et résoudre les problèmes fonctionnels, de sécurité, de sûreté ou de performance rencontrés lors de l’implémentation.

Durant toute la durée de ce stage, vous travaillerez en étroite collaboration avec les équipes architecture, conception, compilateur et outils de développement, qui vous accompagneront et vous formeront.

Profile

Vous suivez une formation BAC+5 en électronique (Master 2 ou 3ème année d'école d'ingénieurs) et recherchez un stage de fin d’études de 6 mois.

Vous connaissez les langages de description VHDL ou Verilog, de vérification systemVerilog, les langages de scripting (Tcl, Python) et de gestion de version (Git). 

Vous êtes familiarisé(e) avec les architectures de processeurs embarqués et les périphériques

 

Vous aimez travailler en équipe, avec un bon sens de la communication, et vous faites preuve de curiosité.

Position location

Job location

Europe, France, Grenoble

Candidate criteria

Education level required

5 - Master degree

Experience level required

Less than 2 years

Languages

·  French (3- Advanced)
·  English (2- Business fluent)

Requester

Desired start date

01/02/2022

Faire de chaque avenir une réussite.
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