Expire bientôt Cnrs - Observatoire De Paris

Développeur System-On-Chip sur FPGA Xilinx (H/F)

  • Meudon (Hauts-de-Seine)
  • Développement informatique

Description de l'offre

Développeur System-On-Chipsur FPGA Xilinx (H/F) Contexte Le LESIA (Laboratoire d'Etudes Spatiales et d'Instrumentation en Astrophysique – www.lesia.obspm.fr) est une unité mixte de recherche CNRS/Observatoire de Paris. Pour observer le ciel depuis le sol ou l’espace, le LESIA développe des instruments de mesures très pointus. En l’occurrence, dans la perspective des futures missions spatiales, nous développons une nouvelle génération de récepteurs dans la gamme 1kHz–50MHz. Pour cette étude, nous déployons une plateforme radio-logicielle au cœur de laquelle se trouve un SoC FPGA.Dans ce contexte, nous recherchons un(e) étudiant(e) spécialisé(e) en développement FPGA. Mission Vous intégrerez l’équipe projet en tant que concepteur / développeur sur la cible Zynq7000 (System-On-Chip Xilinx). Sous la responsabilité de l’architecte FPGA, vousdéveloppezune partie des fonctions en vous appuyant sur les spécifications techniques. Votre travail s’articulera en deux étapes : La première consistera à déployerl’infrastructure de ctrl/cmde à partir d’IPcores hard et soft Le second volet portera sur la conception en VHDL des fonctions d’acquisition et de traitement Vous participerez également aux tests et à la validation des fonctions FPGA sur la plateforme radio-logicielle. Activités Vous aurez à intervenir sur l’ensemble du flot de conception hardware : Participation à la conception de l’architecture du SoC Instanciation de IP hard/soft Codage en VHDL des composants spécifiques Simulations RTL et post-layout Validationdu design sur la cible matérielle Rédaction du rapport de conception et de validation Profil De formation Bac+5 (Ingénieur ou Master) en système embarqué, vous disposez de bonnes connaissances en électronique numérique et des notions en traitement du signal. Vous connaissez les technologies FPGA et les outils de conception sur cible SoC Zynq7000. Design RTL en VHDL (ou Verilog) Toolchain Xilinx (Vivado) Simulations RTL Curieux et créatif, vous appréciez le travail en équipe tout en étant autonome et vous avez un bon esprit d’analyse. Durée et lieu D’une durée de 5 à 6 mois,le stage se déroulera dans les locaux du LESIA, CNRS/Observatoire de Paris – Campus de Meudon. Contact Moustapha DEKKALI  :  : 01 45 07 76 86

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